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전자회로실험 결과보고서-공통소스 증폭기
| 자료번호 | e608433 | ||
|---|---|---|---|
| 수정일 | 2012.10.02 | 등록일 | 2009.06.20 |
| 페이지수 | 6Page | 파일형식 |  한글(hwp) |
| 판매자 | fo******** | 가격 | 1,300원 |
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소개글
전자회로실험 결과보고서-공통소스 증폭기 자료입니다.
목차
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본문내용
실험 22. 공통소스 증폭기
1. 실험목적
이 실험의 목적은 (1) 자기바이어스된 공통소스 증폭기의 동작과 특성에 대하여 설명하고 (2) 실험 20에서 측정한 JFET의 파라미터를 사용하여 전압이듯에 영향을 미치는 요인을 조사하는 것에 있다.
Data값에 대한 분석(결론)
먼저 이번 실험의 목적은 (1) 자기바이어스된 공통소스증폭기의 동작과 특성에 대해 설명하고, (2) 전압이득에 영향을 미치는 요인을 확인하는 것에 있다. 크게 공통소스증폭기안에는 자기바이어스가 되어있어 먼저 자기바이어스에 대해 살펴보도록 하겠다. 자기바이어스는
Gate 바이어스의 소스단자 쪽에 저항을 추가시켜 동작점을 안정시킨 회로로써 BJT의 Emitter feed back bias와 유사함을 알 수 있다. 또 자기바이어스, Gate 바이어스, 공통소스증폭기 등 거의 모든 JFET은 게이트에 역방향 바이어스를 걸어주어야 한다.( 공핍층의 조절을 위해 게이트족에 음의 전압을 걸어주어야 한다. ) 그러나 자기 바이어스 같은 경우 회로를 분석해 보면 게이트쪽에 음의 전압이 걸린 것이 아니라 접지로 연결되어 있음을 알 수 있다. 이를 극복하기 위해 자기바이어스 내, 즉 소스쪽에 저항을 추가시켜서 음의 전압이 걸리게 만들었음을 알 수 있다. 이를 식으로 다시 분석해 보면 VGS=VG-VS 로 이는 다시 VGS=VG-ID×RS로 표현할 수 있다.( JFET회로에서 모든 소스전류는 드레인쪽으로 흐르는 것을 알 수 있는데 이는 게이트와 소스사이의 역방향 바이어스 때문에 전류가 흐르지
..........
Discussion
이 실험에서는 공통소스증폭기에 내제되어 있는 자기바이어스의 특징을 설명함과 동시에 전압이득에 영향을 미치는 요인에 대하여 알아보았다. 입력단(VG)과 출력단(VD)의 180°의 위상차를 가지게 되는 특징과 함께 정상회로일 경우를 기준으로 잡아 부하저항 제거회로와 바이패스와 부하저항 제거회로의 전압이득을 분석해 보았다.
정상회로는 으로
........
1. 실험목적
이 실험의 목적은 (1) 자기바이어스된 공통소스 증폭기의 동작과 특성에 대하여 설명하고 (2) 실험 20에서 측정한 JFET의 파라미터를 사용하여 전압이듯에 영향을 미치는 요인을 조사하는 것에 있다.
Data값에 대한 분석(결론)
먼저 이번 실험의 목적은 (1) 자기바이어스된 공통소스증폭기의 동작과 특성에 대해 설명하고, (2) 전압이득에 영향을 미치는 요인을 확인하는 것에 있다. 크게 공통소스증폭기안에는 자기바이어스가 되어있어 먼저 자기바이어스에 대해 살펴보도록 하겠다. 자기바이어스는
Gate 바이어스의 소스단자 쪽에 저항을 추가시켜 동작점을 안정시킨 회로로써 BJT의 Emitter feed back bias와 유사함을 알 수 있다. 또 자기바이어스, Gate 바이어스, 공통소스증폭기 등 거의 모든 JFET은 게이트에 역방향 바이어스를 걸어주어야 한다.( 공핍층의 조절을 위해 게이트족에 음의 전압을 걸어주어야 한다. ) 그러나 자기 바이어스 같은 경우 회로를 분석해 보면 게이트쪽에 음의 전압이 걸린 것이 아니라 접지로 연결되어 있음을 알 수 있다. 이를 극복하기 위해 자기바이어스 내, 즉 소스쪽에 저항을 추가시켜서 음의 전압이 걸리게 만들었음을 알 수 있다. 이를 식으로 다시 분석해 보면 VGS=VG-VS 로 이는 다시 VGS=VG-ID×RS로 표현할 수 있다.( JFET회로에서 모든 소스전류는 드레인쪽으로 흐르는 것을 알 수 있는데 이는 게이트와 소스사이의 역방향 바이어스 때문에 전류가 흐르지
..........
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정상회로는 으로
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참고문헌
본 자료는 참고문헌이 없습니다.
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